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全加器是算術(shù)運算的基本單元,提高一位全加器的性能是提高運算器性能的重要途徑之一。首先提出多數(shù)決定邏輯非門的概念和電路設(shè)計,然后提出一種基于多數(shù)決定邏輯非門的全加器電路設(shè)計。該全加器僅由輸入電容和CMOS反向器組成,較少的管子、工作于極低電源電壓、短路電流的消除是該全加器的三個主要特征。對這種新的全加器,用PSpice進行了晶體管級模擬。結(jié)果顯示,這種新的全加器能正確完成加法器的邏輯功能。
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