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介紹了一種相位開關型分頻器電路的噪聲分析方法。這種方法基于頻率綜合器的頻域模型,能比較準確地預測分頻器的相位噪聲和它對整個頻率綜合器相位噪聲的影響。分頻器電路采用0.18μm CM O S工藝設計,用于W CDM A通訊系統中。在分析過程中,針對此電路的相位開關結構,提出了一些改進其噪聲性能的方法。最后用仿真結果進行分析驗證,仿真結果和理論相符合。
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為了提高反熔絲FPGA芯片分頻電路的系統工作頻率,針對ACTEL公司提供的反熔絲芯片A32100DX,提出了基于計數器、移位寄存器與狀態機的分頻器VHDL編程方法,給出了硬件開發設計流程及3種設計方法的源程序,并對采用局部時鐘及全局時鐘、同步復位、異步復位、以及復位置零的計數器法在高低溫環境下進行了后仿真對比分析,后仿真對比及燒寫后的實測結果表明同步復位的移位寄存器分頻方法后仿真速度最高,但在燒寫后工作的可靠性不高,容易出現無輸出現象,采用全局時鐘且同步復位清零的計數器法速度較高,且工作可靠,已經在型號設計中采用。
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