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更新時間:2025.05.11
實驗13VHDL三態門

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實驗十三 三態門、 OC門的設計與仿真 一、實驗內容 1.在 Quartus II 中用邏輯圖和 VHDL語言設計三態門,三態門的使能端對低電平有效。 2.在 Quartus II 中用邏輯圖和 VHDL語言設計一個 OC門(集電極開路門)。 二、電路要求 三態門、 OC門的邏輯圖; 用 VHDL語言設計三態門、 OC門,用盡量多的方法來描述; 三、電路功能介紹 1.三態門,又名三態緩沖器( Tri-State Buffer ) 用途:用在總線傳輸上,有效而又靈活地控制多組數據在總線上通行,起著交通信號燈 的作用。 邏輯圖 真值表 EN A OUT 0 0 Hi-Z 0 1 Hi-Z 1 0 0 1 1 0 VHDL程序 行為描述: 結構體描述: 波形圖 2.OC門,又名集電極開路門( opndrn) 用途:集電極開路門( OC門)是一種用途廣泛的門電路。典型應用是可以實 現線與的功能。

1三態開關的工作原理

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1、 三態開關的工作原理: DIN DOUT E Din 為數據輸入端 Dout 為數據輸出端 E 為控制端高電平有效 2、半加器本位和邏輯表達式 ,半加器進位邏輯表達式,及電路。 3、 全加器本位和邏輯表達式,全加器向高位進位的邏輯表達式,電路。 4、設計一個具有十個輸入端的 BCD 碼編碼器?(要求列出真值表,寫出邏輯表達式,畫 出邏輯框圖) 5、設計一個三八譯碼器: (要求列出真值表,寫出邏輯表達式,畫出邏輯框圖)

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