基于ARM9芯片S3C2410異常中斷程序設計
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多重中斷程序測試框架
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為了解決多重中斷的執行不確定性帶來的測試困難問題,在多重中斷產生并發錯誤的特點的基礎上,提出了一種多重中斷程序測試框架。該測試框架通過從外部加載一組合適的中斷信號序列控制中斷處理程序的執行過程,迫使中斷程序經歷待測序列,避免了構造復雜的運行時控制環境。實驗結果表明,相對于一般的中斷錯誤分析方法,該測試框架能夠對順序程序多重中斷環境下可能產生并發錯誤的時序環境和具體原因進行較為準確地分析。
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