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更新時間:2025.05.17
CADENCE原理圖與PCB設計說明

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內部資料 請勿外傳 CADENCE原理圖與 PCB設計說明 (第 1 版) - I - 目錄 目 錄 序 言 .............................................................................................................................................................. 1 第一章 系統簡介 ........................................................................................................................................ 2 1.1 系統組成 .......................

硬件開發的原理圖設計規范詳細說明

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硬件開發的原理圖設計規范詳細說明 ? 一、原理圖網絡命名 ? ? ? 原理圖網絡命名時,字母必須為大寫字母,不可以使用字母 “O”;可以使 用下劃線和左斜線 “/”;禁止使用小寫字母、短橫線、 *等; ? ? ? 電源網絡命名建議: 10V 以上命名舉例, 12V、36V 等,數字在字母 V 前;10V 以下電源命名舉例, V33 或者 3V3、V18 或者 1V8、V09 或者 0V9;模擬電源命名舉例, V33_AVDD_FPGA 或者 3V3_AVDD_FPGA ;可 以增加后綴說明電源使用對象; ? ? ? 時鐘網絡命名規則:時鐘網絡命名以 CLK 開頭,后接頻率,可以增加使 用對象說明,舉例 CLK_50M_CPU; ? ? ? 總線網絡命名規則:總線類型開頭,后接使用對象或者總線方向,舉例 SGMII_CPU_PHY 、JTAG_TDI_CPU 、PCIE_CPU_FPGA、

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